[TI] VHDL

[bunower]

so in der Probeklausur ist in der aufgabe 13 b folgender code gegeben:

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proc_3 : process(clk, reset)
begin
if reset = ’1’ then
x <= ’0’;
c <= ’0’;
elsif clk’event and clk = ’1’ then
x <= input;
if x = ’1’ then
c <= not input;
end if;
end if;
end process;
end behavioral;

so eigentlich ist mir alles klar bis auf die variable c, die mache ich immer falsch,
dies bedeutet doch während x=1 ist, ist c = not input.
Hier ist die lösung und das zweite c ist meine lösung.

[Domestos]

Da haben wir wohl einen Post zum selben Thema^^
Zu deinem könnte ich sagen, dass c nur bei aufsteigender Flanke von clock und x=1 zu not input wird.

[bunower]

das geht aber auch nicht keine ahnung verstehe da irgendwie etwas falsch

[minuq]

Da wo du c auf 1 setzt ist kein clk'event, demzufolge trifft

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elsif clk’event and clk = ’1’ then

nicht zu.
Weiterhin ist bei jedem clk'event x=0 oder input=0, woraus wiederum x=0 folgt.

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if x = ’1’ then
c <= not input;


Wird dementsprechend nie ausgeführt, da x immer auf 0 gesetzt wird.

Hoffe damit deine Frage beantwortet zu haben .

[bunower]

ja denke schon danke.